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MCDT
MCDT实验——lab1
TB1从verilog到SV的进场 要求1.1 一致,questasim对.v文件是兼容的 要求1.2(如果出现一致,可能是因为cho_margin的位宽问题,给的源文件位宽是5[4:0]不是6[5:0]) 一致 要求1.3 一致 TB2方法task和函数function 要求2.1 时钟和复位信号 ......
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lab1
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更新时间 2023-04-04
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