源码 硬件9054 fpga

04 FPGA光通信之8B10B ADC采集传输

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! ......
光通信 8B10B FPGA 10B B10

3-1-04 FPGA使用fdma读写DDR

软件版本:vitis2021.1(vivado2021.1) 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 4.1概述 在前文的实验中我们详细介绍了FDMA的使用方法 ......
FPGA fdma DDR 04

1-1-02 AMD(XILINX) FPGA开发工具Vitis(vivado)安装

1.1Vitis概述 Vitis 统一软件平台可实现在 Xilinx 异构平台(包括 FPGA、SoC 和 Versal ACAP)上开发嵌入式软件和加速应用。它可为边缘、云和混合计算应用加速提供统一编程模型。 利用与高层次框架的集成,通过加速库采用 C、C++ 或 Python 进行开发,或者使用 ......
开发工具 工具 XILINX vivado Vitis

Volcano 原理、源码分析(一)

0. 总结前置 1. 概述 2. Volcano 核心概念 2.1 认识 Queue、PodGroup 和 VolcanoJob 2.2. Queue、PodGroup 和 VolcanoJob 的关系 3. Volcano 调度框架概览 4. 源码分析 4.1 Action 实现在哪里? 4.2 ......
源码 原理 Volcano

CountDownLatch源码解析

CountDownLatch源码解析 countdown是倒计时的意思,latch是门闩的意思,也有门锁的意思,合起来字面意思就是一个倒计树计锁器的意思,先来看一个具体的案例分析大致了解 import java.util.concurrent.CountDownLatch; public class ......
CountDownLatch 源码

37 基于FPGA的LVDS信号环路测试

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 LVDS(Low Voltage Differ ......
环路 信号 FPGA LVDS 37

31 基于FPGA简易示波器显示驱动设计

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 FPGA在数据采集,数据处理,图像视频领域都有 ......
示波器 简易 FPGA 31

29 基于FPGA实现触摸屏实验

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 常规情况下我们会使用CPU通过I2C接口实现触 ......
触摸屏 FPGA 29

ReentrantReadWriteLock源码阅读

ReentrantReadWriteLock源码阅读 目录ReentrantReadWriteLock源码阅读简介例子代码分析总览Syncstate定义lock count和hold countSync.HoldCounter类Sync类其他成员变量tryAcquiretryReleasetryAc ......
ReentrantReadWriteLock 源码

sync.Pool底层源码详解

Golang中sync.Pool用来提高对象复用几率,减少gc的压力,减少内存分配,它是线程安全的,常用来存储并复用临时对象。 任何存放区其中的值可以在任何时候被删除而不通知,在高负载下可以动态的扩容,在不活跃时对象池会收缩。 可伸缩的,其大小仅受限于内存的大小,可以被看作是一个存放可重用对象的值的 ......
底层 源码 sync Pool

07 FPGA按钮去抖实验

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MILIANKE)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 按键的消抖,是指按键在闭合或松开的瞬间伴随着一 ......
按钮 FPGA 07

08 FPGA多路分频器实验

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MILIANKE)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 在FPGA中,时钟分频是经常用到的。本节课讲解 ......
分频器 FPGA 08

05 FPGA流水灯实验

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 本章课程以大家熟悉的流水灯为例子,详细讲解了V ......
流水 FPGA 05

OpenEuler22.03源码编译安装nginx1.24.0

一、环境说明 操作系统版本:OpenEuler22.03 SP2 LTS Nginx版本:1.24.0 安装位置:/app/nginx Selinux配置:关闭或设置为permissive 二、Nginx安装 # 安装必要依赖 dnf -y install tar gcc make pcre pcr ......
OpenEuler 源码 nginx1 22.03 nginx

基于源码去理解Iterator迭代器的Fail-Fast与Fail-Safe机制

原创/朱季谦 在Java编程当中,Iterator迭代器是一种用于遍历如List、Set、Map等集合的工具。这类集合部分存在线程安全的问题,例如ArrayList,若在多线程环境下,迭代遍历过程中存在其他线程对这类集合进行修改的话,就可能导致不一致或者修改异常问题,因此,针对这种情况,迭代器提供了 ......
Fail Fail-Fast Fail-Safe 源码 Iterator

FPGA处理编码信号进行毛刺滤波

目录一、前言二、滤波算法三、代码设计 一、前言 在利用处理编码信号时,一般在较为理想的环境下可以很方便进行计算,判断等。但是由于有时候受到电磁干扰等环境因素,会导致编码信号产生毛刺等,这时候如果不对编码信号进行预处理而是直接进行边缘判断等操作则极容易导致错误,所以需要提前对编码信号进行滤波。 二、滤 ......
毛刺 信号 编码 FPGA

《FPGA原理和结构》——读书笔记

最近做了一个关于FPGA的项目后,读了《FPGA原理和结构》这本书。主要梗概内容和想法如下。 第一章:理解FPGA所需要的基础知识 理解FPGA我们需要数电的组合逻辑、时序逻辑等内容的知识。FPGA(20世纪70年度发展起来的,因为其具有通过组合使用器件内大量的逻辑块来实现所需的电路,比以往侠义的P ......
原理 结构 笔记 FPGA

FPGA驱动AD9240实现AD转换

目录一、前言二、时序原理三、代码设计四、结果验证 一、前言 在做项目中,经常会用到AD转换模块。前段时间做毕业设计的时候需要用到FPGA驱动AD9240模块实现模拟数据的采集和转换,尽管相对来说AD9240算比较简单的驱动模块,但是也想记录下分析和设计过程。 二、时序原理 首先通过芯片手册可以看到A ......
FPGA 9240 AD

DAC转化——FPGA驱动LTC1446

目录一、前言二、结合LTC1446芯片手册分析三、Verilog代码与仿真四、总结 一、前言 最近在学习利用FPGA结合DAC芯片实现数模转换,在实验中选择的LTC1446这款芯片。接下来自己将结合芯片手册进行分析,并编写Verilog代码并进行仿真验证。 二、结合LTC1446芯片手册分析 首先从 ......
1446 FPGA DAC LTC

语音直播聊天交友小程序(艾思软件 定制开发 源码交付)

语音直播聊天交友小程序的开发涉及到多个技术领域,包括前端开发、后端开发、音频处理技术等。在前端开发方面,需要使用HTML5、CSS3和JavaScript等技术来实现用户界面的设计和交互功能。在后端开发方面,需要使用Node.js、PHP或Java等编程语言来搭建服务器,处理用户的请求和数据存储。 ......
定制开发 源码 语音 程序 软件

源码补丁神器—patch-package

一、背景 vue项目中使用 vue-pdf 第三方插件预览pdf,书写业务代码完美运行,pdf文件内容正常预览无问题。后期需求有变,业务需求增加电子签章功能。这个时候pdf文件的内容可以显示出来,但是公司的电子签章无法显示。这令人沮丧,因为已经编写了许多特定于此依赖项的代码,如果替换依赖库,这些代码 ......
神器 patch-package 源码 补丁 package

基于FPGA的图像差分运算及目标提取实现,包含testbench和MATLAB辅助验证程序

1.算法运行效果图预览 2.算法运行软件版本 matlab2022a 3.算法理论概述 基于FPGA(Field-Programmable Gate Array)的图像差分运算及目标提取实现主要涉及图像处理、差分运算和目标提取等原理和数学公式。 一、图像处理原理 图像处理是一种对图像信息进行加工、分 ......
testbench 图像 目标 程序 MATLAB

ThreadPoolExecutor源码学习

Java构建线程的方式 集成Thread 实现Runnable 实现CallAble 线程池方式 Java提供了Executors创建(不推荐,不方便进行控制) 推荐手动创建线程池ThreadPoolExecutor。 ThreadPoolExecutor参数 int corePoolSize 核心 ......
ThreadPoolExecutor 源码

# ReentrantLock源码阅读

ReentrantLock源码阅读 目录ReentrantLock源码阅读简介例子代码分析Sync.tryLockSync.initialTryLockSync.lockSync.tryReleaseNonFairSync.initialTryLockNonFairSync.tryAcquireFa ......
ReentrantLock 源码

【C语言数据结构】对Lua Table源码的一次劣质学习

/* new_key */ KLcBool KLcmCreateMapKeyValue(KLCMAP_PTR pTag, KLCTVALUE_PTR pKv) { KLcBool kbRet = KL_FALSE; KLcBool kbIsKvLegal = KL_FALSE; DWORD dwIn ......
数据结构 源码 语言 结构 数据

01 FPGA流水灯实验

软件版本:VIVADO2021.1 操作系统:WIN10 64bit 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录米联客(MiLianKe)FPGA社区-www.uisrc.com观看免费视频课程、在线答疑解惑! 1 概述 本章课程以大家熟悉的流水灯为例子,详细讲解了V ......
流水 FPGA 01

Java线程池ThreadPoolExecutor源码解析

Java线程池ThreadPoolExecutor源码解析 1.ThreadPoolExecutor的构造实现 以jdk8为准,常说线程池有七大参数,通常而言,有四个参数是比较重要的 public ThreadPoolExecutor(int corePoolSize, int maximumPoo ......
ThreadPoolExecutor 线程 源码 Java

AbstractQueuedSynchronizer源码阅读

AbstractQueuedSynchronizer源码阅读 目录AbstractQueuedSynchronizer源码阅读例子Overview-CLH锁Overview的剩余内容代码分析cleanQueueacquireacquire总结acquire共享模式补充release内部类Condit ......
AbstractQueuedSynchronizer 源码

1-STM32F103+ESP8266+EC800K(移远4G Cat1)--硬件使用说明

<p><iframe name="ifd" src="https://mnifdv.cn/resource/cnblogs/ZLIOTB/EC800K/my.html" frameborder="0" scrolling="auto" width="100%" height="1500"></ifr ......
使用说明 硬件 8266 Cat1 STM

基于FPGA的图像PSNR质量评估计算实现,包含testbench和MATLAB辅助验证程序

1.算法运行效果图预览 设置较大的干扰,PSNR=15。 设置较小的干扰,PSNR=25。 2.算法运行软件版本 matlab2022a vivado2019.2 3.算法理论概述 基于FPGA的图像PSNR(峰值信噪比)质量评估计算实现涉及到数字图像处理、硬件设计和编程等多个领域。PSNR是一种用 ......
testbench 图像 质量 程序 MATLAB
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